在高速PCB設計時，設計者應該從那些方面去考慮EMC、EMI的規(guī)則呢？
一般EMI/EMC設計時需要同時考慮輻射(radiated)與傳導(conducted)兩個方面。前者歸屬于頻率較高的部分(>30MHz)后者則是較低頻的部分(<30MHz)。所以不能只注意高頻而忽略低頻的部分。
一個好的EMI/EMC設計必須一開始布局時就要考慮到器件的位置，PCB疊層的安排，重要聯(lián)機的走法，器件的選擇等，如果這些沒有事前有較佳的安排，事后解決則會事倍功半，增加成本。
例如時鐘產(chǎn)生器的位置盡量不要靠近對外的連接器，高速信號盡量走內層并注意特性阻抗匹配與參考層的連續(xù)以減少反射，器件所推的信號之斜率(slewrate)盡量小以減低高頻成分，選擇去耦合(decoupling/bypass)電容時注意其頻率響應是否符合需求以降低電源層噪聲。
另外，注意高頻信號電流之回流路徑使其回路面積盡量小(也就是回路阻抗loopimpedance盡量小)以減少輻射。還可以用分割地層的方式以控制高頻噪聲的范圍。
適當?shù)倪x擇PCB與外殼的接地點(chassisground)。 PCB的這些事,你不一定都知道!pcb打樣抄板
PCB多層板LAYOUT設計規(guī)范之四：
25.PCB布線基本方針：增大走線間距以減少電容耦合的串擾；平行布設電源線和地線以使PCB電容達到比較好；將敏感高頻線路布設在遠離高噪聲電源線的位置；加寬電源線和地線以減少電源線和地線的阻抗；
26.分割：采用物理上的分割來減少不同類型信號線之間的耦合，尤其是電源與地線
27.局部去耦：對于局部電源和IC進行去耦，在電源輸入口與PCB之間用大容量旁路電容進行低頻脈動濾波并滿足突發(fā)功率要求，在每個IC的電源與地之間采用去耦電容，這些去耦電容要盡可能接近引腳。
28.布線分離：將PCB同一層內相鄰線路之間的串擾和噪聲耦合**小化。采用3W規(guī)范處理關鍵信號通路。
29.保護與分流線路：對關鍵信號采用兩面地線保護的措施，并保證保護線路兩端都要接地
30.單層PCB：地線至少保持1.5mm寬，跳線和地線寬度的改變應保持比較低
31.雙層PCB：優(yōu)先使用地格柵/點陣布線，寬度保持1.5mm以上。或者把地放在一邊，信號電源放在另一邊
32.保護環(huán)：用地線圍成一個環(huán)形，將保護邏輯圍起來進行隔離 pcba加工打樣貼片快速的交付以及過硬的產(chǎn)品品質贏得了國內外客戶的信任。
PCB多層板LAYOUT設計規(guī)范之六：
40.倒角規(guī)則：PCB設計中應避免產(chǎn)生銳角和直角，產(chǎn)生不必要的輻射，同時工藝性能也不好，所有線與線的夾角應大于135度
41.濾波電容焊盤到連接盤的線線應采用0.3mm的粗線連接，互連長度應≤1.27mm。
42.一般情況下，將高頻的部分設在接口部分，以減少布線長度。同時還要考慮到高/低頻部分地平面的分割問題，通常采用將二者的地分割，再在接口處單點相接。
43.對于導通孔密集的區(qū)域，要注意避免在電源和地層的挖空區(qū)域相互連接，形成對平面層的分割，從而破壞平面層的完整性，并進而導致信號線在地層的回路面積增大。
44.電源層投影不重疊準則：兩層板以上（含）的PCB板，不同電源層在空間上要避免重疊，主要是為了減少不同電源之間的干擾，特別是一些電壓相差很大的電源之間，電源平面的重疊問題一定要設法避免，難以避免時可考慮中間隔地層。
45.3W規(guī)則：為減少線間竄擾，應保證線間距足夠大，當線中心距不少于3倍線寬時，則可保持70%的電場不互相干擾，如要達到98%的電場不互相干擾，可使用10W規(guī)則。
46.20H準則：以一個H(電源和地之間的介質厚度)為單位，若內縮20H則可以將70%的電場限制在接地邊沿內，內縮 1000H則可以將98%的電場限制在內。
PCB多層板LAYOUT設計規(guī)范之三：
19.在正式布線之前，首要的一點是將線路分類。主要的分類方法是按功率電平來進行，以每30dB功率電平分成若干組
20.不同分類的導線應分別捆扎，分開敷設。對相鄰類的導線，在采取屏蔽或扭絞等措施后也可歸在一起。分類敷設的線束間的**小距離是50~75mm
21.電阻布局時，放大器、上下拉和穩(wěn)壓整流電路的增益控制電阻、偏置電阻（上下拉）要盡可能靠近放大器、有源器件及其電源和地以減輕其去耦效應（改善瞬態(tài)響應時間）。
22.旁路電容靠近電源輸入處放置
23.去耦電容置于電源輸入處。盡可能靠近每個IC
24.PCB基本特性阻抗：由銅和橫切面面積的質量決定。具體為：1盎司0.49毫歐/單位面積電容：C=EoErA/h，Eo：自由空間介電常數(shù)，Er：PCB基體介電常數(shù)，A：電流到達的范圍，h：走線間距電感：平均分布在布線中，約為1nH/m盎司銅線來講，在0.25mm(10mil)厚的FR4碾壓下，位于地線層上方的）0.5mm寬，20mm長的線能產(chǎn)生9.8毫歐的阻抗，20nH的電感及與地之間1.66pF的耦合電容。 .將散熱器靠近機箱接縫，通風口或者安裝孔的金屬部件上的邊和拐角要做成圓弧形狀。
高頻高速PCB設計中，添加測試點會不會影響高速信號的質量？
會不會影響信號質量要看加測試點的方式和信號到底多快而定?；旧贤饧拥臏y試點(不用在線既有的穿孔(viaorDIPpin)當測試點)可能加在在線或是從在線拉一小段線出來。
前者相當于是加上一個很小的電容在在線，后者則是多了一段分支。這兩個情況都會對高速信號多多少少會有點影響，影響的程度就跟信號的頻率速度和信號緣變化率(edgerate)有關。
影響大小可透過仿真得知。原則上測試點越小越好(當然還要滿足測試機具的要求)分支越短越好。 隔離方法包括：屏蔽其中一個或全部屏蔽、空間遠離、地線隔開。高速pcb制板
為什么要導入類載板極細化線路疊加SIP封裝需求?pcb打樣抄板
PCB四層板的疊層
1.SIG－GND(PWR)－PWR(GND)－SIG；
2.GND－SIG(PWR)－SIG(PWR)－GND；
以上兩種疊層設計，潛在的問題是對于傳統(tǒng)的1.6mm（62mil）板厚。層間距將會變得很大，不僅不利于控制阻抗，層間耦合及屏蔽；特別是電源地層之間間距很大，降低了板電容，不利于濾除噪聲
第一種方案，通常應用于板上芯片較多的情況。此方案可得到較好的SI性能，對于EMI性能來說并不是很好，主要要通過走線及其他細節(jié)來控制。注意：地層放在信號**密集的信號層的相連層，利于吸收和抑制輻射；增大板面積，體現(xiàn)20H規(guī)則。
第二種方案，應用于板上芯片密度足夠低和芯片周圍有足夠面積(放置所要求的電源覆銅層)的場合。此種方案PCB的外層均為地層，中間兩層均為信號/電源層。信號層上的電源用寬線走線，這可使電源電流的路徑阻抗低，且信號微帶路徑的阻抗也低，也可通過外層地屏蔽內層信號輻射。從EMI控制的角度看，是現(xiàn)有的比較好4層PCB結構。
注意：中間兩層信號、電源混合層間距要拉開，走線方向垂直，避免出現(xiàn)串擾；適當控制板面積，體現(xiàn)20H規(guī)則；如要控制走線阻抗，上述方案要非常小心地將走線布置在電源和接地鋪銅的下邊。另外，電源或地層上的鋪銅之間盡可能地互連一起，以確保DC和低頻的連接性 pcb打樣抄板
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